美国多所高校联合研发出商业代工环境下首个单片3D集成电路原型
近日，由斯坦福大学、卡内基梅隆大学、宾夕法尼亚大学和麻省理工学院组成的研究团队宣布，在商业代工厂环境中成功制造出美国首个单片3D集成电路原型。该芯片采用垂直堆叠架构，将内存与逻辑电路集成在同一硅片上，通过优化数据路径显著提升了计算性能与能效，为未来芯片设计提供了新的技术方向。
该原型芯片采用SkyWater公司成熟的90纳米至130纳米工艺，在其200毫米生产线上完成制造。芯片结构集成了传统硅基CMOS逻辑电路、电阻式随机存取存储层以及碳纳米管场效应晶体管，通过单片三维集成技术实现了存储与计算单元的直接垂直堆叠。这一设计大幅缩短了数据在内存与处理器之间的传输距离，降低了延迟与能耗。
实际测试数据显示，与具有相近延迟和尺寸的传统二维芯片相比，该3D堆叠结构在吞吐量上提升约4倍。通过仿真模型进一步评估显示，若增加堆叠层数并优化内存与计算资源配置，该架构在AI负载中的性能提升最高可达12倍。研究团队指出，通过持续扩展垂直集成规模而非单纯依赖晶体管微缩，该技术路径有望在能量延迟积（综合衡量芯片速度与能效的指标）上实现100倍至1000倍的提升。
值得关注的是，尽管学术界此前已开展多项3D芯片实验，但此项工作的突破在于其完全在商业化代工厂的标准产线上实现，而非依赖定制化科研设备。这表明该技术具备较高的产业适配潜力，为未来从实验室走向规模化生产奠定了基础。
当前，随着摩尔定律演进放缓，芯片行业正积极寻求通过三维集成、先进封装、新器件材料等途径延续算力增长。此次3D单片集成电路原型的成功验证，为高性能计算、人工智能及边缘设备等领域的芯片设计提供了新思路。通过将存储与计算更紧密地集成，不仅能够缓解“内存墙”瓶颈，也为实现更高能效、更低延迟的异构计算架构创造了条件。
未来，随着制造工艺进一步成熟、设计工具链完善及产业链协同深化，3D单片集成技术有望在特定高性能与高能效场景中率先实现应用。此项研究也为全球半导体产业探索后摩尔时代的技术创新路径提供了重要参考，展现出产学研协同在推动前沿技术落地方面的关键作用。随着相关进展的持续推进，3D集成电路或将成为下一代芯片技术竞争的重要焦点之一。
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